ETISS 0.8.0
Extendable Translating Instruction Set Simulator (version 0.8.0)
- a -
add_rd_rs1_rs2 :
RV64IMACFD_RV32IInstr.cpp
,
RV32IMACFD_RV32IInstr.cpp
addi_rd_rs1_imm :
RV64IMACFD_RV32IInstr.cpp
,
RV32IMACFD_RV32IInstr.cpp
addiw_rd_rs1_imm :
RV64IMACFD_RV64IInstr.cpp
addw_rd_rs1_rs2 :
RV64IMACFD_RV64IInstr.cpp
amoaddd_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amoaddw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amoandd_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amoandw_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV32AInstr.cpp
,
RV32IMACFD_RV32AInstr.cpp
amomaxd_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amomaxud_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amomaxuw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amomaxw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amomind_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amominud_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amominuw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amominw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amoord_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amoorw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amoswapd_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amoswapw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
amoxord_rd_rs1_rs2_rl_aq :
RV64IMACFD_RV64AInstr.cpp
amoxorw_rd_rs1_rs2_rl_aq :
RV32IMACFD_RV32AInstr.cpp
,
RV64IMACFD_RV32AInstr.cpp
and_rd_rs1_rs2 :
RV32IMACFD_RV32IInstr.cpp
,
RV64IMACFD_RV32IInstr.cpp
andi_rd_rs1_imm :
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,
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Arg :
xray_records.h
auipc_rd_imm :
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,
RV64IMACFD_RV32IInstr.cpp
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1.9.1